Логические схемы, т.е. устройства, имеющие не менее двух входов, работающих на один выход: ..в схемах на полевых транзисторах – H03K 19/017

Изобретение относится к области вычислительной техники и может быть использовано для реализации КМДП логических устройств конвейерного типа. Достигаемый технический результат - повышение быстродействия устройства. Тактируемый многовходовый элемент И содержит элемент И-НЕ (1), инвертирующий элемент (2), тактовый транзистор n-типа (3), тактовый транзистор p-типа (4), транзистор обратной связи n-типа (5) и транзистор обратной связи p-типа (6). Элемент И-НЕ (1) содержит предзарядовый транзистор p-типа (7), ключевую цепь (8) и дополнительную ключевую цепь (9). Инвертирующий элемент (2) содержит логический транзистор p-типа (10) и предзарядовый транзистор n-типа (11). Ключевые цепи (8) и (9) выполнены на последовательно соединенных транзисторах n-типа, затворы которых являются входами устройства. 1 ил.

Изобретение относится к области вычислительной техники и может быть использовано в МДП интегральных схемах для реализации логических устройств. Достигаемый технический результат - уменьшение потребляемой мощности. Парафазный логический элемент содержит предзарядовые и логические транзисторы р-типа, предзарядовые и тактовый транзистор n-типа, логический блок, содержащий прямые и инверсные ключевые цепи на последовательно соединенных транзисторах n-типа. 2 ил.

Изобретение относится к области вычислительной техники и может быть использовано в МДП интегральных схемах при реализации логических устройств. Устройство содержит элемент И-НЕ (1), инвертирующий элемент (ИЭ) (2), тактовые транзисторы (Т) (3) и (4) соответственно n-типа и р-типа, дополнительный Т (5) n-типа. Элемент И-НЕ (1) содержит предзарядовый Т (6) р-типа и ключевую цепь (7), выполненную на последовательно соединенных Т n-тина, затворы которых подключены к входам (8) устройства. Предзарядовый Т (6) включен между шиной питания (9) и выходом (10) элемента И-НЕ (1). Первый вывод (11) ключевой цепи (7) элемента И-НЕ (1) соединен с выходом (10) элемента И-НЕ (1), а второй вывод (12) через тактовый Т (3) соединен с нулевой шиной (13), тактовый Т (4) включен между шиной питания (9) и вторым выводом (12) ключевой цепи (7). Затворы тактовых Т (3, 4) и предзарядового Т (6) подключены к тактовой шине (14). ИЭ (2) содержит логический Т (15) р-типа, включенный между шиной питания (9) и выходом (16), и предзарядовый Т (17) n-типа, включенный между выходом устройства и нулевой шиной, затворы Т (15, 17) ИЭ (2) подключены соответственно к выходу (10) и к второму выводу (12) ключевой цепи (7). Дополнительный Т (5), затвор которого соединен с выходом (16) устройства, включен между выходом (10) устройства и вторым выводом (12) ключевой цепи (7). Технический результат - повышение быстродействия устройства. 1 ил.

Изобретение относится к схемному устройству и способу формирования выходного сигнала двойной шины с устройством (12) обработки сигнала с переключателями, управляемыми в зависимости от входного сигнала <а, aq>, а также с двумя выходами (х, xq), причем посредством одного из переключателей (s, sq) первый выход (х), а посредством другого переключателя (sq, s) второй выход (xq) могут соединяться с опорной точкой (v) управляющего устройства, находящейся на первом потенциале (0). Устройство обработки сигнала через переключающее устройство (13) соединено с выходами схемного устройства для выдачи выходного сигнала двойной шины <z, zq>. При этом выходы (E1, E2) переключающего устройства (13) в зависимости от управляющего сигнала (7), могут соединяться соответственно с одним или обоими входами (D1, D2). Также предусмотрено устройство контроля потенциала для установления потенциалов выходов (F1, F2) схемного устройства, когда они не связаны через переключающее устройство (13) и устройство (12) обработки сигнала с опорной точкой (v) устройства обработки сигнала. 2 с. и 4 з.п. ф-лы, 8 ил.